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verilog除頻器可用於編碼段運(yùn)用可以穩(wěn)定電路設(shè)計(jì)
標(biāo)簽： verilog
上傳時(shí)間： 2013-12-26
上傳用戶：372825274
C程式設(shè)計(jì)語(yǔ)言基礎(chǔ) 適合正在學(xué)習(xí)C語(yǔ)言的人
標(biāo)簽： 程式 正
上傳時(shí)間： 2016-10-30
上傳用戶：xuan‘nian
網(wǎng)路流視頻的一些基礎(chǔ)概念 包含基礎(chǔ)視頻介紹 流視頻傳輸概念等
標(biāo)簽：
上傳時(shí)間： 2017-06-18
上傳用戶：qq21508895
用於相位法激光測(cè)距的電路系統(tǒng)設(shè)計(jì)----
標(biāo)簽： 相位法 激光 系統(tǒng)
上傳時(shí)間： 2017-04-21
上傳用戶：dave520l
用電路圖所設(shè)計(jì)的counter 淺顯易懂~~~~
標(biāo)簽： counter
上傳時(shí)間： 2013-12-10
上傳用戶：2467478207
這是一堆verilog的source code.包含許多常用的小電路.還不錯(cuò)用.
標(biāo)簽： verilog source code
上傳時(shí)間： 2015-03-29
上傳用戶：lanwei
完整的jpeg encoder verilog code,DCT部分採(cǎi)用1991 IEEE transection paper,利用skew circular convolution來(lái)實(shí)現(xiàn)精簡(jiǎn)電路
標(biāo)簽： convolution transection circular encoder
上傳時(shí)間： 2014-01-20
上傳用戶：waizhang
使用FPGA設(shè)計(jì)WiMax接收機(jī)之OFDM同步硬體電路(內(nèi)附VHDL code)
標(biāo)簽： WiMax FPGA OFDM VHDL
上傳時(shí)間： 2016-01-22
上傳用戶：zhuyibin
是一個(gè)用verilog寫成的加法器電路,可把七個(gè)元件加起來(lái)
標(biāo)簽： verilog 加法器 元件
上傳時(shí)間： 2014-01-07
上傳用戶：zhangzhenyu
使用硬體描述語(yǔ)言HDL 設(shè)計(jì)硬體電路，臺(tái)灣人寫的PPT講義，非常不錯(cuò)。VHDL硬件設(shè)計(jì)入門學(xué)習(xí)。VHDL基本語(yǔ)法架構(gòu)，VHDL的零件庫(kù)(Library)及包裝(Package)等內(nèi)容。
標(biāo)簽： HDL
上傳時(shí)間： 2014-01-22
上傳用戶：cxl274287265
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